IC697BEM731

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串状DAC是实现Flash-ADC的逆操作，因使用电阻串来构造参考电压而得名，在有的书中也被称为开尔文分配器。串状DAC依靠待转换数据来控制一组开关，以产生合适的电流通过精密电阻，从而产生合适的模拟信号电压。
 
并行结构只需要一级模拟电路，因此具有设计简单，转换时间短，速度快的优点，在所有可能的结构中提供zui快的数据转换。在分辨率要求较低的情况下，Flash-ADC和串状DAC两种结构都容易采用超大规模集成电路（VLSI）进行设计。然而，由于比较器（或开关）和精密电阻的数量随着转换器的分辨率呈指数增长，Flash-ADC和串状DAC的芯片面积和功耗也随之呈指数增长。
 
2．分段结构
 
分段结构的数据转换器的思想是把输入信号分成MSB和LSB两个分量，之后两个分量通过各自所对应的数据转换器进行处理，zui后将处理的结果组合起来形成输出信号。其中MSB分量反映了输入信号相对较大的幅度增量，而LSB反映了在MSB上所叠加的较小的幅度变化。对于数字信号而言，MSB代表了高位比特，而LSB代表了低位比特。
 
而软件无线电所生成的数字信号也需要变换成模拟信号才能进行射频放大输出。这一切都是通过A/D转换器（ADC）和D/A转换器（DAC）来实现的。
 
与传统无线电不同，软件无线电要求尽可能地以数字形式处理无线信号，因此必须将A/D和D/A转换器尽可能地向天线端推移，这就对A/D和D/A转换器的性能提出了更高的要求。主要体现在两个方面。
 
（1）采样速率。依据采样定理，A/D转换器的抽样频率应大于（为被采样信号的带宽）。在实际中，由于A/D转换器件的非线性、量化噪声、失真及接收机噪声等因素的影响，一般选取。
 
（2）分辨率。采样值的位数的选取需要满足一定的动态范围及数字部分处理精度的要求，一般分辨率80dB的动态范围要求下不能低于12位。

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