PHBAIN12010000
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厦门航拓电气有限公司
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全功率输入带宽（FullPowerAnalogInputBandwidth）是指当ADC输出信号幅度低于zui大输出电平3dB时的输入信号频率范围。一般采样速率越高，全功率输入带宽就越宽。对于ADC而言，被采样信号的带宽必须在全功率输入带宽之内，否则在模拟输入带宽之外的频率成分因衰减过多而无法正确地反映原始信号。
软件无线电中通常采用的ADC和DAC的结构包括以下4种类型：
（1）并行结构，包括Flash-ADC和串状DAC；
（2）分段结构，包括折叠内插ADC和“分段”梯形DAC；
（3）迭代结构，包括分区ADC、流水线型ADC、逐次逼近型ADC；
（4）Σ-△结构，包括Σ-△ADC和DAC。
下面以ADC为例对以上几种结构进行介绍。
1．并行结构
并行结构的数据转换器的基本思想是：同时比较待转换的信号电平与所有级别的量化电平之间的关系，在模拟信号和数字信号之间相互转换。并行结构所对应的A/D和D/A转换器件分别为Flash-ADC和串状DAC。
Flash-ADC内含一列并联比较器，一列由电阻分压器产生的电平作为相应的比较器的基准电压。被转换的模拟电压信号同时加到全部比较器上，各比较器的输出经编码后作为ADC的输出，如图2.12所示。
一个分辨率为N（bit）的Flash-ADC含有2N个精密电阻，2N?1个高速比较器；分辨率每增加1bit，需要增加2N个精密电阻和2N个高速比较器，这会大大增加集成的复杂度和器件功耗。因此一般Flash-ADC的分辨率无法达到很高。
串状DAC是实现Flash-ADC的逆操作，因使用电阻串来构造参考电压而得名，在有的书中也被称为开尔文分配器。串状DAC依靠待转换数据来控制一组开关，以产生合适的电流通过精密电阻，从而产生合适的模拟信号电压。
DAI03
DAI04
CP502
DSQC327 3HAB7230-1
DSQC500 3HAC3616-1/07
3BHT300053R1
GJR5251600R0202
DSQC345A 3HAB810-1
DSQC503 3HAC3619-1
6204BZ10100D
3BSE008508R1
RLM01 3BDZ000398R1
3HAC6550-1
CL-LMR+CL-LER
3BDH000017R1
3BSE004282R1
3BSE004802R0001
57120001-AT
57120001-P
57160001-ACA
57160001-K
DSDO110
DCSMB510
3BSE002540R1
PM154
3BSE003645R1
PM153
3BSE003644R1
PM151
3BSE003642R1
PM152
3BSE003643R1
IMMFP01
IMCPM02
IMDSO14
INBIM02
IMFEC12
IEPAS02
INBTM01
3BSE008580R1
PM810V1
PM150V+PM151+PM152+PM153+PM154
PM150 3BSE003641R1
3BSE000435R1
CI520
3BSE001800R1
AC31 07KGJR5253100R4278
DSSR116
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